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    下載用于鈍化完整性測試的嵌入式結構的技術資料

    文檔序號:5459246

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    本發明涉及一種用于測試覆蓋半導體器件的鈍化層(108)的完整性的方法和系統。將導電材料的結構層(104)沉積到所述半導體器件的襯底(102)的至少一部分頂部表面上。所述結構層(104)包括多個帶(104.1,104.2),所述多個帶與至少兩...
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