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    鎖相頻率合成器及自適應頻率校準電路和校準方法技術

    技術編號:8685175 閱讀:192 留言:0更新日期:2013-05-09 04:53
    本發明專利技術公開了鎖相頻率合成器及自適應頻率校準電路和校準方法,具有自適應頻率校準電路的鎖相頻率合成器,包括鑒頻鑒相器、電荷泵、環路濾波器、可變計數器、壓控振蕩器、自適應頻率校準電路和控制開關,其特征在于:自適應頻率校準電路包括計數器、比較器以及狀態機;壓控振蕩器通過控制開關接收基準電壓信號,產生頻率信號輸出到可變計數器;可變計數器將收到的信號進行分頻處理后輸出壓控振蕩器的分頻時鐘信號到計數器和鑒頻鑒相器;本發明專利技術使壓控振蕩器輸出頻率首先由自適應頻率校準電路輸出的數字信號進行控制,使壓控振蕩器的分頻時鐘信號頻率調整到與參考時鐘信號頻率相近,再由環路濾波器輸出的控制電壓進一步調整壓控振蕩器的頻率。

    【技術實現步驟摘要】

    本專利技術涉及鎖相頻率合成器,具體涉及。
    技術介紹
    鎖相頻率合成器是采用鎖相環(PLL)進行頻率合成的一種頻率合成器,它是目前頻率合成器主流。鎖相式整數頻率合成器由鑒頻鑒相器(PFD)、電荷泵(CP)、可變計數器(/N)、環路濾波器(LPF)、壓控振蕩器(VCO)等部分組成。鎖相頻率合成器是一個相位誤差控制系統,它比較輸入信號和壓控振蕩器輸出信號之間的相位差,從而產生誤差控制電壓來調整壓控振蕩器的頻率,以達到與輸入信號同頻。在環路開始工作時,如果輸入參考時鐘頻率與VCO時鐘頻率不同,則由于兩信號之間存在固有的頻率差,它們之間的相位差勢必一直在變化,結果鑒頻鑒相器輸出的誤差電壓就在一定范圍內變化。在這種誤差電壓的控制下,壓控振蕩器的頻率也在變化。并且,壓控振蕩器的工作頻率對工藝非常敏感,特別是壓控振蕩器的振蕩頻率在1000MHz以上,不同批次芯片及工藝本身所造成的工藝偏差會影響VCO頻率的一致性。增加VCO的壓控頻率增益可以增加VCO的頻率覆蓋范圍,在一定程度上抵消工藝偏差對VCO頻率的影響,但增加VCO的壓控增益會增加VCO的相位噪聲。AFC(Adaptive Frequency Calibration自適應頻率校準)其功能是在鎖頻鎖相初期,由基準電路產生某一固定電壓作為VCO的壓控電壓,通過一定的算法對參考時鐘與VCO分頻后的時鐘頻率進行比較,從而調整壓控振蕩器的振蕩頻率。
    技術實現思路
    本專利技術所要解決的技術問題之一在于提供具有自適應頻率校準電路的鎖相頻率合成器。本專利技術所要解決的技術問題之二在于提供分段式壓控振蕩器自適應頻率校準電路。本專利技術所要解決的技術問題之三在于提供分段式壓控振蕩器自適應頻率校準方法。為了解決上述技術問題,本專利技術的第一個技術方案是,具有自適應頻率校準電路的鎖相頻率合成器,包括鑒頻鑒相器、電荷泵、環路濾波器、可變計數器、壓控振蕩器、自適應頻率校準電路和控制開關,其特征在于:自適應頻率校準電路包括計數器、比較器以及狀態機;壓控振蕩器通過控制開關接收基準電壓信號,產生頻率信號輸出到可變計數器;可變計數器將收到的信號進行分頻處理后輸出壓控振蕩器的分頻時鐘信號到計數器和鑒頻鑒相器;計數器同時接收參考時鐘信號和壓控振蕩器的分頻時鐘信號進行計數,當其中一個時鐘信號計數結束時,計數器產生一個脈沖信號輸出到比較器;比較器收到計數器輸出的脈沖信號后進行比較,再根據比較結果產生指示信號并同時產生狀態機時鐘信號一并輸出給狀態機;狀態機受比較器輸出的狀態機時鐘信號的控制,并根據指示信號,產生控制信號輸出到壓控振蕩器,以調整壓控振蕩器的時鐘信號頻率;當壓控振蕩器的分頻時鐘信號頻率等于參考時鐘信號頻率,狀態機輸出開關控制信號,使控制開關與基準電壓信號斷開并與環路濾波器接通,壓控振蕩器通過控制開關接收環路濾波器輸出的控制電壓信號。本專利技術采用將壓控振蕩器分成若干頻段,以增加壓控振蕩器的頻率范圍,壓控振蕩器的每一頻段都具有較小的壓控頻率增益,而多個頻段完全可以覆蓋所需的頻率范圍并保留一定余量;與采用鑒頻鑒相器的傳統PLL環路相比,壓控振蕩器輸出頻率首先由自適應頻率校準電路輸出的數字信號進行控制,自動尋找最適合目標頻率的頻段,使壓控振蕩器的分頻時鐘信號頻率能夠調整到與參考時鐘信號頻率相近,并保持工作在這個頻段;再由環路濾波器輸出的控制電壓進一步調整壓控振蕩器的頻率,達到穩定后,參考時鐘信號和壓控振蕩器分頻時鐘信號之間的頻差為零,相差不再隨時間變化,誤差電壓為一固定值,這時環路就進入“鎖定”狀態。采用頻率分段結構及自適應頻率校準電路,能避免VCO頻率受到工藝偏差的影響,即使工藝不一致造成壓控振蕩器的頻率變化,在設定范圍內總會使壓控振蕩器滿足所需頻率要求,保證芯片一致性,提高產品成品率;并且整個校準工作由芯片內部自動完成,無需外部控制,既滿足了壓控振蕩器頻率的一致性問題,同時簡化了應用方案。所述狀態機包括邏輯電路、寄存器組一和寄存器組二 ;寄存器組一和寄存器組二均受比較器輸出的狀態機時鐘信號的控制;寄存器組一作為存儲加/減數的寄存器;邏輯電路接收寄存器組一輸出的數據,并同時接收比較器輸出的指示信號,進行邏輯運算后輸出到寄存器組二,寄存器組二產生控制信號輸出到壓控振蕩器,以調整壓控振蕩器的時鐘信號頻率。 所述寄存器組一由第η寄存器、第η-1寄存器、第n_2寄存器……第一寄存器、第零寄存器組成;寄存器組二由第m寄存器、第m-Ι寄存器……第I寄存器組成;邏輯電路由η個邏輯電路單元和第零或門構成,其中:n ^ 2的自然數;m=n ;每個邏輯電路單元均包括一個與門、一個或門和一個異或門;第η寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器采用串行環形連接;第η與門的I個輸入端連接第η-1寄存器的輸出端Q,第η與門的另I個輸入端連接比較器的比較指示信號輸出端;第η與門的輸出端連接第η或門的一個輸入端,第η或門的另一個輸入端連接第η寄存器的輸出端Q,第η或門的輸出端連接第η異或門的一個輸入端,第η異或門的另一個輸入端連接第m寄存器的輸出端Q,第η異或門的輸出端連接第m寄存器的輸入端D ;依次類推,第一與門的I個輸入端連接第零寄存器的輸出端Q,第一與門的另I個輸入端連接比較器的比較指示信號輸出端;第一與門的輸出端連接第一或門的一個輸入端,第一或門的另一個輸入端連接第一寄存器的輸出端Q,第一或門的輸出端連接第一異或門的一個輸入端,第一異或門的另一個輸入端連接第I寄存器的輸出端Q,第一異或門的輸出端連接第I寄存器的輸入端D ;第m寄存器、第m-1寄存器……第I寄存器的輸出端Q共輸出η位控制信號到壓控振蕩器;第η寄存器、第n-1寄存器、第η-2寄存器……第一寄存器、第零寄存器的時鐘信號輸入端以及第m寄存器、第m-1寄存器……第I寄存器的時鐘信號輸入端均連接比較器的狀態機時鐘信號輸出端;第η寄存器、第η-2寄存器……第一寄存器、第零寄存器的復位端CLR、第η_1寄存器的置位端SET以及第m-Ι寄存器……第I寄存器的復位端CLR和第m寄存器的置位端SET均連接復位信號,該復位信號由外部輸入,比較器的相同指示信號輸出端連接第零或門的一個輸入端,第零或門的另一個輸入端連接第η寄存器的輸出端Q,第零或門的輸出端輸出開關控制信號到控制開關,控制控制開關與基準電壓信號連接或與可變計數器連接。本專利技術的第二個技術方案是,分段式壓控振蕩器自適應頻率校準電路,包括比較器、計數器以及狀態機,其特點是:參考時鐘信號和壓控振蕩器的分頻時鐘信號同時輸入計數器進行計數,當其中一個時鐘信號計數結束時,計數器產生一個脈沖信號輸出到比較器;表示其中一個時鐘信號計數完成;比較器收到計數器輸出的脈沖信號后進行比較,以確定參考時鐘信號和壓控振蕩器的分頻時鐘信號中是哪一個時鐘先計數結束或是同時計數結束,即比較參考時鐘信號和壓控振蕩器的分頻時鐘信號的頻率大小,再根據比較結果產生指示信號并同時產生狀態機時鐘信號一并輸出給狀態機;狀態機受比較器輸出的狀態機時鐘信號的控制,并根據指示信號,產生控制信號輸出到壓控振蕩器,以調整壓控振蕩器的時鐘信號頻率。本專利技術的第三個技術方案是,分段式壓控振蕩器自適應頻率校準方法,其特點是:包括如下步驟:將一個標準電壓輸入 壓控振蕩器作為壓控本文檔來自技高網...

    【技術保護點】
    具有自適應頻率校準電路的鎖相頻率合成器,包括鑒頻鑒相器(14)、電荷泵(15)、環路濾波器(16)、可變計數器(17)、壓控振蕩器(18)、自適應頻率校準電路(10)和控制開關(19),其特征在于:自適應頻率校準電路(10)包括計數器(11)、比較器(12)以及狀態機(13);壓控振蕩器(18)通過控制開關(19)接收基準電壓信號,產生頻率信號輸出到可變計數器(17);可變計數器(17)將收到的信號進行分頻處理后輸出壓控振蕩器的分頻時鐘信號到計數器(11)和鑒頻鑒相器(14);計數器(11)同時接收參考時鐘信號和壓控振蕩器的分頻時鐘信號進行計數,當其中一個時鐘信號計數結束時,計數器(11)產生一個脈沖信號輸出到比較器(12);比較器(12)收到計數器(11)輸出的脈沖信號后進行比較,再根據比較結果產生指示信號并同時產生狀態機時鐘信號一并輸出給狀態機(13);狀態機(13)受比較器(12)輸出的狀態機時鐘信號的控制,并根據指示信號,產生控制信號輸出到壓控振蕩器(18),以調整壓控振蕩器(18)的時鐘信號頻率;當壓控振蕩器的分頻時鐘信號頻率等于參考時鐘信號頻率,狀態機(13)輸出開關控制信號,使控制開關(19)與基準電壓信號斷開并與環路濾波器(16)接通,壓控振蕩器(18)通過控制開關(19)接收環路濾波器(16)輸出的控制電壓信號。...

    【技術特征摘要】
    1.有自適應頻率校準電路的鎖相頻率合成器,包括鑒頻鑒相器(14)、電荷泵(15)、環路濾波器(16)、可變計數器(17)、壓控振蕩器(18)、自適應頻率校準電路(10)和控制開關(19),其特征在于:自適應頻率校準電路(10)包括計數器(11)、比較器(12)以及狀態機(13); 壓控振蕩器(18)通過控制開關(19)接收基準電壓信號,產生頻率信號輸出到可變計數器(17); 可變計數器(17)將收到的信號進行分頻處理后輸出壓控振蕩器的分頻時鐘信號到計數器(11)和鑒頻鑒相器(14); 計數器(11)同時接收參考時鐘信號和壓控振蕩器的分頻時鐘信號進行計數,當其中一個時鐘信號計數結束時,計數器(11)產生一個脈沖信號輸出到比較器(12); 比較器(12)收到計數器(11)輸出的脈沖信號后進行比較,再根據比較結果產生指示信號并同時產生狀態機時鐘信號一并輸出給狀態機(13); 狀態機(13)受比較器(12)輸出的狀態機時鐘信號的控制,并根據指示信號,產生控制信號輸出到壓控振蕩器(18),以調整壓控振蕩器(18)的時鐘信號頻率;當壓控振蕩器的分頻時鐘信號頻率等于參考時鐘信號頻率,狀態機(13)輸出開關控制信號,使控制開關(19)與基準電壓信號斷開并與環路濾波器(16)接通,壓控振蕩器(18)通過控制開關(19)接收環路濾波器(16)輸出的控制電壓信號。2.根據權利要求1所述的具有自適應頻率校準電路的鎖相頻率合成器,所述狀態機(13)包括邏輯電路(33)、寄存器組一(31)和寄存器組二(32);寄存器組一(31)和寄存器組二(32)均受比較器(12)輸出的狀態機時鐘信號的控制;寄存器組一(31)作為存儲加/減數的寄存器;邏輯電路(33)接收寄存器組一(31)輸出的數據,并同時接收比較器(12)輸出的指示信號,進行邏 輯運算后輸出到寄存器組二(32),寄存器組二(32)產生控制信號輸出到壓控振蕩器(18),以調整壓控振蕩器(18)的時鐘信號頻率。3.根據權利要求2所述的具有自適應頻率校準電路的鎖相頻率合成器,所述寄存器組一 (31)由第η寄存器、第η-1寄存器、第η_2寄存器……第一寄存器、第零寄存器組成;寄存器組二(32)由第m寄存器、第m- 寄存器……第I寄存器組成;邏輯電路由η個邏輯電路單元和第零或門構成,其中:n ^ 2的自然數;m=n ;每個邏輯電路單元均包括一個與門、一個或門和一個異或門;第η寄存器、第η-1寄存器、第η-2寄存器……第一寄存器、第零寄存器采用串行環形連接;第η與門的I個輸入端連接第η-1寄存器的輸出端Q,第η與門的另I個輸入端連接比較器的比較指示信號輸出端;第η與門的輸出端連接第η或門的一個輸入端,第η或門的另一個輸入端連接第η寄存器的輸出端Q,第η或門的輸出端連接第η異或門的一個輸入端,第η異或門的另一個輸入端連接第m寄存器的輸出端Q,第η異或門的輸出端連接第m寄存器的輸入端D ;依次類推,第一與門的I個輸入端連接第零寄存器的輸出端Q,第一與門的另I個輸入端連接比較器的比較指示信號輸出端;第一與門的輸出端連接第一或門的一個輸入端,第一或門的另一個輸入端連接第一寄存器的輸出端Q,第一或門的輸出端連接第一異或門的一個輸入端,第一異或門的另一個輸入端連接第I寄存器的輸出端Q,第一異或門的輸出端連接第I寄存器的輸入端D ;第m寄存器、第m-Ι寄存器……第I寄存器的輸出端Q共輸出η位控制信號到壓控振蕩器(18);第η寄存器、第η_1寄存器、第η-2寄存器……第一寄存器、第零寄存器的時鐘信號輸入端以及第m寄存器、第m-1寄存器……第I寄存器的時鐘信號輸入端均連接比較器(12)的狀態機時鐘信號輸出端;第η寄存器、第η-2寄存器……第一寄存器、第零寄存器的復位端CLR、第η_1寄存器的置位端SET以及第m-Ι寄存器……第1寄存器的復位端CLR和第m寄存器的置位端SET均連接復位信號,該復位信號由外部輸入,比較器(12)的相同指示信號輸出端連接第零或門的一個輸入端,第零或門的另一個輸入端連接第η寄存器的輸出端Q,第零或門的輸出端輸出開關控制信號到控制開關(19),控制控制開關(19)與基準電壓信號連接或與可變計數器(17)連接。4.相頻率合成器分段式壓控振蕩器自適應頻率校準電路,包括計數器(11)、比較器(12)以及狀態機(13),其特征在于: 參考時鐘信號和壓控振蕩器的分頻時鐘信號同時輸入計數器(11)進行計數,當其中一個時鐘信號計數結束時,計數器(11)產生一個脈沖信號輸出到比較器(12); 比較器(12)收到計數器(11)輸出的脈沖信號后進行比較,再根據比較結果產生指示信號并同時產生狀態機時鐘信號一并輸出給狀態機(13); 狀態機(13)受比較器(12)輸出的狀態機時鐘信號的控制,并根據指示信號,產生控制信號輸出到壓控振蕩器(18),以調整壓控振蕩器(18)的時鐘信號頻率。5.根據權利要求4所述的鎖相頻率合成器分段式壓控振蕩器自適應頻率校準電路,其特征在于:所述狀態機(13)包括邏輯電路(33)、寄存器組一(31)和寄存器組二(32);寄存器組一(31)和寄存器組二(32)均受比較器(12)輸出的狀態機時鐘信號的控制;寄存器組一(31)...

    【專利技術屬性】
    技術研發人員:徐驊李明劍劉永光吳炎輝范麟萬天才
    申請(專利權)人:重慶西南集成電路設計有限責任公司
    類型:發明
    國別省市:

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